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ZXMP3A17E6電路的狀態方程組而求其次態

發布時間:2020/1/23 14:36:15 訪問次數:1081

zxmp3a17e6再觀察表6.3.7,又出現狀態d和f是等價的,狀態f亦可去除,代之以d。于是,得到表6,3,8所示的狀態表。檢查該表,已不存在等價狀態,因此是最簡狀態表。根據表6.3.8畫出的狀態圖如圖6.3.11所示。

                                                 

表6,3.8 例6.3.3的最簡狀態表,上述狀態化簡過程將原有的7個狀態化簡為5個,而輸人一輸出特性與原始狀態表和原始狀態圖完全相同。

狀態分配,表6.3.8中列出5個狀態,最簡單7y的狀態分配是使用自然二進制碼,取進制計數序列的前5個連續編碼,如6.3.9中的狀態分配方案1。結合6.3.11可以看出,這種二進制編碼值遞增順序基本上與相應的狀態轉換順一致。對于較簡單的時序電路,按這狀態分配方案構成的時序電路,其組δ電路將可能相對簡單一些。

                       

表6,3.9中所列方案2為格雷碼方案。如果狀態圖所示的主要狀態轉換順序是簡單的從o到e,那么它從一個狀3.11 化簡后的狀態圖電路的可靠性。

雖然這將使用較多的觸,有些國外文獻稱之為“0ne~hot encoding”,國內某些文獻直譯為“1位熱碼編碼”。

態轉換到下狀態,使用表6.3發器,但它的編碼方式非常簡單,可有效地簡化組合電路,并且還可以提高工作可靠性和工作速度。在大規模可編程邏輯器件,例如fpga(見7.4節)中,觸發器數量較多而門邏輯相對較少,“一對一”的編碼方案有時反而更有利于提高器件資源的利用率。

時序邏輯電路次態/輸出(s/y)現態(sn)△=1,次態/輸出(sn+1/y)a=1現態(s)a=0,得到三個觸發器的激勵方程組

d2=0+1=0i0

£)1=q+1=qi0+qia+0a

do=0+l=a

圖6.3.12表6.3.11的卜諾圖y=q100a+q2a,經卡諾圖化簡,和輸出方程z經過幾次實踐之后,實際上可不必列狀態轉換真值表接從狀態表得到卡諾圖。

                                 

畫出邏輯圖,并檢查自啟動能力,根據激勵方程組和輸出方程,可以畫出圖6.3,13所示的邏輯圖。如果reser端接邏輯1該電路將有3個無效狀態:101、110和111,將這3個狀態作為現態,與不同的輸人變量一起分別代人電路的狀態方程組而求其次態。結果證明,這3個狀態在一個時鐘周期后全部都能進入有效狀態。于是,可畫出完全狀態圖,如圖6.3.14所示。

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